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Regulator的原理與設計運用(2)
以TO252包裝為例，通常若耗電為2W者，在常溫下大約會有70℃。若耗電為3W者，於常溫下可能到達90℃，以上數據不適用於所有model(僅供參考)。 以下列出幾種M/B上常見的LDO形式及其線路供大家參考。...
2013-12-19 -
Regulator的原理與設計運用(1)
1.電壓增益無限大。(A=Vo/Vd≒) 2.輸入阻抗無限大。 (Zin≒) 3.輸出阻抗為零。 (Zout ≒0) 4.無限大的電流輸出能力。 (Iout ≒) 5.頻寬無限大。 1.同相(或反相)放大器。2.電壓隨耦器、比較器、加法器、減法器、微分器、積分器、。 註1：利用右圖的同相放大器線路，搭配適當的電晶體或 MOSFET即可做出 Linear Regulator。 註2：右圖中若令R2=0，並移除R1，則成為電壓隨耦器 (Voltage Follower)，亦即 Vo=Vi。 Regulator...
2013-12-19 -
NB主機板目檢注意事項
MS-1013 Modem Cable線太接近Clock Chip EMI fail MS-1013 Modem cable理線方案避免EMI issue EMI 接地彈片 on M/BEMI 接地彈片不可倒在M/B 主機板上...
2013-12-18 -
cpu重点信号（5）
實驗機種 : 8GEM667K-GB-10FEX 1 : 將 ICH SERIRQ Pull High 電阻 open , 不影響開機EX 2 : 將 ICH SERIRQ Pull High 電阻鄰腳 ( GPO19 ) short , 不影響開機EX 3 : 將 ICH SERIRQ 與 Super I/O open , 不影響開機EX 4 : 將 ICH SERIRQ 與 Super I/O 相鄰腳 PIN69 short , 不影響開機EX 5 : 將 ICH SERIRQ 與 Super I/O...
2013-12-18 -
cpu重点信号（4）
北橋重點控制腳位說明 2.) RS# Processor System BUS Interface 3.) HLock# Host Lock: All processor bus cycles sampled with the assertion of HLOCK# and ADS#, until the negation of HLOCK# must be atomic (i.e., no hub interface or AGP snoopable access to SDRAM are allowe...
2013-12-17
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